技术标签： fifo 数字电路 fpga xilinx # 数字IC前端设计基础 ram
关于创建和配置IP，可以参考我的另一篇文章：Vivado 双口RAM IP核的使用，不同之处只是在于本文使用的伪双端口RAM的写端口和读端口都加了使能信号，也即没有选择始终使能。
这里需要注意的是，如果想要解决读写冲突，也就是当同时读写同一地址时，能读出之前存在该地址的旧数据，也能将要写的新数据正确写入到该地址，那写端口的操作模式一定要选择READ_FIRST或者NO_CHANGE。
如果选择WRITE_FIRST，那么当读写冲突时，读出的数据是此时准备写入的数据，并不是之前存储的数据，这显然不符合逻辑。
1、关于写地址的变化，只需考虑we有效的情况：
总结起来，（we有效&&（（re无效&
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